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【2h】

Fully Integrated CMOS Phase-Locked Loop With 30MHz to 2GHz Locking Range and +-35ps Jitter

机译：完全集成的CmOs锁相环，具有30mHz至2GHz的锁定范围和+ 35ps的抖动

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作者
Chao Xu; Winslow Sargeant; Kenneth R. Laker; Jan Van Der Spiegel;
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年度 2015
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1. A fully integrated CMOS phase-locked loop with 30 MHz to 2 GHz locking range and ±35 ps jitter [J] . Chao Xu, Winslow Sargeant, Kenneth R. Laker, Analog Integrated Circuits and Signal Processing . 2003,第1a2期

机译：具有30 MHz至2 GHz锁定范围和±35 ps抖动的完全集成CMOS锁相环
2. Fully integrated CMOS phase-locked loop with 15 to 240 MHz locking range and /spl plusmn/50 ps jitter [J] . Novof I.I., Austin J. IEEE Journal of Solid-State Circuits . 1995,第11期

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3. A 7.6 mW, 414 fs RMS-Jitter 10 GHz Phase-Locked Loop for a 40 Gb/s Serial Link Transmitter Based on a Two-Stage Ring Oscillator in 65 nm CMOS [J] . Woorham Bae, Haram Ju, Kwanseo Park, IEEE Journal of Solid-State Circuits . 2016,第10期

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4. Fully integrated CMOS phase-locked loop with 30MHZ to 2GHZ locking range and ±35PS jitter [C] . Chao Xu, Winslow Sargeant, Kenneth Laker, IEEE International Conference on Electronics, Circuits and Systems . 2001

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5. A study of phase noise and jitter in submicron CMOS phase-locked loop circuits. [D] . Zhang, Chi. 2006

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6. Design of a Sub-Picosecond Jitter with Adjustable-Range CMOS Delay-Locked Loop for High-Speed and Low-Power Applications [O] . Bilal I. Abdulrazzaq, Omar J. Ibrahim, Shoji Kawahito, 2016

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